InterDigitated Capacitor (IDC) は、インダクタンスを低減する一次方法と二次方法の両方を利用します。 IDC アーキテクチャは、終端間の距離を縮めて電流ループ サイズを最小限に抑え、隣接する対向する電流ループを作成することでインダクタンスをさらに低減します。 IDC は、低 ESL 向けに最適化された内部構造を備えた 80 つのコンデンサです。 標準の MLCC と LICC の比較と同様に、ESL の削減は EIA ケースのサイズによって異なります。 通常、同じ EIA サイズの場合、IDC は MLCC よりも少なくとも XNUMX% 低い ESL を提供します。
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